第二章（3）Verilog HDL行为语句

Verilog定义的模块一般包括有过程语句，过程语句有两种：initial、always。其中initial常用于仿真中的初始化，其中的语句只执行一次，而always中语句则是不断重复执行的。

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自己动手写CPU

共49讲

自己动手写CPU教程，来源：https://blog.csdn.net/leishangwen/category_5723475

目录
第一章（1）计算机的简单模型、架构、指令集
第一章（2）MIPS指令集架构的演变
第一章（3）MIPS32指令集架构简介
第二章（1）可编程逻辑器件与PLD电路设计流程
第二章（2）Verilog HDL简介
第二章（3）Verilog HDL行为语句
第二章（4）电路设计举例
第二章（5）ModelSim电路仿真
第三章 教学版OpenMIPS处理器蓝图
第四章（1）第一条指令ori的实现
第四章（2）验证第一条指令ori的实现效果
第四章（3）MIPS编译环境的建立
第四章（4）Makefile文件建立
第五章（1）流水线数据相关问题
第五章（2）OpenMIPS对数据相关问题的解决措施
第五章（3）MIPS指令集中的逻辑、移位与空指令
第五章（4）逻辑、移位与空指令的实现
第五章（5）测试逻辑、移位与空指令的实现
第六章（1）移动操作指令说明
第六章（2）移动操作指令实现思路
第六章（3）移动操作指令的实现
第六章（4）验证移动操作指令实现效果
第七章（1）简单算术操作指令说明
第七章（2）简单算术操作指令实现过程
第七章（3）简单算术操作指令实现过程（续）
第七章（4）验证简单算术操作指令实现效果
第七章（5）流水线暂停机制的设计与实现
第七章（6）乘累加指令实现思路
第七章（7）乘累加指令的实现
第七章（8）验证乘累加指令的实现效果
第七章（9）除法指令说明及实现思路
第七章（10）除法指令实现过程1
第七章（11）除法指令实现过程2
第八章（1）转移指令介绍
第八章（2）转移指令实现思路
第八章（3）转移指令实现过程1
第八章（4）转移指令实现过程2
第九章（1）加载存储指令说明1
第九章（2）加载存储指令说明2（lwl、lwr）
第九章（3）加载存储指令说明2（swl、swr）
第九章（4）加载存储指令实现思路
第九章（5）实现加载存储指令1（修改译码阶段）
第九章（5）实现加载存储指令2（修改执行阶段）
第九章（5）实现加载存储指令3（修改访存阶段）
第九章（5）实现加载存储指令4（修改OpenMIPS顶层模块）
第九章（6）修改最小SOPC
第九章（7）MIPS32中的LL、SC指令说明
第九章（8）MIPS32中的LL、SC指令实现思路
第九章（9）修改OpenMIPS以实现ll、sc指令
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